基于MSI的任意进制计数器的设计

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２００６年　４月　第　ｌ０卷第２期　宁　波职业　技术学　院学　报　ＪＯＵＲＮＡＬ　ＯＦ　ＮＩＮＧＢＯ　ＰＯＬＹＴＥＣＨＮＩＣ　Ａｐｒ，２００６　Ｖｂ１．１０ＮＯ．２　基于ＭＳＩ的任意进制计数器的设计　李　争　（新疆昌吉职业技术学院　电气工程系，新疆　昌吉　８５１１　００）　摘要：介绍了利用数字中规模集成电路的控制端功能实现任意进制计数器的方法。并以７４ＬＳ１　６０为例分别介　绍了反馈清零法、反馈置数法和级联法。并对几种方法的优缺点进行了比较。　关键词：ｑ，ｒＬ模集成电路（ＭＳ１）；任意进制计数器；反馈置零法；反馈预置法；级联法　中图分类号：ＴＮ４３　文献标识码：Ａ　文章编号：１６７１—２１５３（２００６）０２—００８４—０２　０引　言　计数器是数字系统中最常用的电路之一，而市　场上现成的中规模集成电路（Ｍｅｄｉｕ１ＴＩ　ＳＣａｌｅ　Ｉｎｔｅｇｒａｔｉｏｎ，ＭＳＩ）芯片常见的只有十进制计数器和十　六进制计数器，而在实际应用中，如数字钟电路中，　却需要二十四进制和六十进制计数器，因此要将现　有计数器改造成任意进制计数器。利用ＭＳＩ芯片进　行适当的连接就可以构成任意进制计数，所使用的　方法主要有反馈置零法、反馈预置法和级联法。本　文以中规模集成电路７４ＬＳ１６０为例介绍任意进制计　数器的构成方法。　１　７４ＬＳ１６０的功能　表　１为真值表。　表１真值表　根据功能表，７４ＬＳ１６０的功能说明如下：　（１）异步清零功能。当ＣＲ＝０时，不论其他输入　如何，输出Ｑ３Ｑ２Ｑ１Ｑ０为００００，表中 “×”表示任　意。　（２）同步并行置数功能。ＬＤ为预置数控制端，在　ＣＲ＝Ｉ的条件下，ＬＤ＝０时，在ＣＰ上升沿的作用下，　预置好的数据ｄ３ｄ２ｄｌｄ０被并行地送到输出端，即此　时的Ｑ３Ｑ２Ｑ１ＱＯ为ｄ３ｄ２ｄｌｄ０。　（３）保持功能。在ＣＲ＝Ｉ和ＬＤ＝Ｉ的前提下，只　要Ｔ　Ｔ　＝０，则计数器不工作，输出保持原状态不变。　

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