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文档格式:pdf 更新日期:2011-07-15第17 讲 计数器的手工设计及专用集成电路设计 题目文档预览: 与74LS161 唯一不同之处在于 74LS160 是一个十进制加法计数器,其余包括引脚端口 的排列也与 74LS161 相同。 例17-2 试用两片同步十进制计数器 74LS160 构成... 点击下载
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文档格式:pdf 更新日期:2011-07-17案例实训指导书之四文档预览: PROM、D/A是大规模集成电路,引脚多,功能复杂。特别是有关控制 输入的时序关系不... CE CS Vcc A0 R/C Vee 12/8 V D D D D T T Q Q Q Q C CP 74LS161 ... 点击下载
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文档格式:pdf 更新日期:2011-09-21第六图书馆文档预览: 用途.74LS161为四位二进制同步计数器(异步清除)1利用它可以组成多种进制的 计数应用电路. 一. 、. 74LS161的管脚图与逻辑图. 关于74Lsl6l计数器的内部 ... 点击下载
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文档格式:pdf 更新日期:2011-09-21第5 章时序逻辑电路习题文档预览: 5.6 采用反馈清零法,将集成计数器74LS161(74LS161 芯片的管脚排列如图. 5.10 所示)构成十三进制计数器,画出逻辑电路图。 5.7 采用反馈置数法清零,将集成 ... 点击下载
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文档格式:pdf 更新日期:2011-03-27控制逻辑电路文档预览: 引脚 定义 引脚 定义 1 BCP 14 ACP 2 R1 13 空3R2 12 Q0 4 空11 Q3 5 VCC 10 GND 6 S1 9 Q1 7 S2 8 Q2 7、74LS161 可预置 4 位二进制同步计数... 点击下载
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文档格式:pdf 更新日期:2011-09-21: 能介绍如表1所文档预览: 图1 引脚图. KSV3208是 ... 压范围在0 2V之. = 间。其引脚排列如. NC. 图1所示。 引脚功. : 能介绍如表1所. AGND. 示。 ... 74LS161产生11位的地址。图2中,“矾P ... 点击下载
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文档格式:pdf 更新日期:2011-09-21实验一门电路逻辑功能及测试文档预览: 附录1 TPE—D6 型数字电路实验学习机常用集成电路引脚图………………………… 81 ...... (1)带 直接清除端的同步可预置数的计数器74LS160 / 74LS161 的逻辑符号如图20.1 ... 点击下载
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文档格式:pdf 更新日期:2011-09-21实验十三计数、译码、显示电路(2 学时) 1 实验目的2 实验原理文档预览: BCD-七段译码器74LS248 的引脚如图12-1 所示,其功能见表. 13-1。 图13-1 74LS248 的引脚图. 表中A、B、C、D 是输入端,输入四位二进制码,a、b、c、d、e、f、 g 是 ... 点击下载
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文档格式:pdf 更新日期:2011-09-21www.tai-yan.com/bbs文档预览: 在不外加门电路的情况下,可级联成N 位同步计数器。 对于54/74LS161,在CLOCk 出现前,即使ENP、ENT、CLEAR 发. 生变化,电路的功能也不受影响。 管脚图: ... 点击下载
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文档格式:pdf 更新日期:2011-09-21第5 章时序逻辑电路文档预览: 1. 集成同步计数器74LS161. 74LS161 是一种同步四位二进制加法集成计数器。其 管脚的排列如图5.10 所. 示,逻辑功能如表5.5 所示。 表5.5 74LS161 逻辑功能表 ... 点击下载
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