VHDL语言入门教学
YiHwa Lai 2003/08/15
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Wireless Access Technology Lab.
大纲
VHDL语言的基本概念 资料型别与资料物件的宣告 VHDL的叙述语法 阶层式设计 函式,程序与套件 问题与讨论 参考资料
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VHDL语言的基本概念
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VHDL历史背景
VHDL-Very High Speed Integrated Circuit Hardware Description Language 1983年美国国防部委托IBM,Texas Instrument,Intermetrics负责发展. 1987年定义成标准硬体语言,此一标准称之为IEEE Std 1076-1987,又称 为VHDL 87. 1993年再次更新,更新后之标准称之为IEEE Std 1076-1993,又称为VHDL 93. 1996年,IEEE将电路合成的程式标准与规格,加入到VHDL电路设计语言 中.
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VHDL基本设计观念
VHDL语言程式之撰写,可分为两个部分:
单体(Entity):电路外观之描述 架构(Architecture):电路内部功能之描述
Ex:
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电路设计中的单体部分
单体部分主要分为两大部分:
单体的宣告 输出入埠的描述
单体宣告的语法如下:
Entity 单体名称 is port( 讯号A :模式 资料型态; 讯号B :模式 资料型态; 讯号N :模式 资料型态);
End 单体名称;
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电路设计中的单体部分(续)
Ex:
ENTITY DFF is PORT(CLK,D: IN STD_LOGIC; Q: OUT STD_LOGIC ); END DFF;
输出入埠模式
In:表示该脚位要从外界接收信号 Out:该脚位将传送信号到外界 Inout:可收送双向模式的Port信号 Buffer:表示缓冲模式的Port讯号 In Out Inout
Buffer
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